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Job Description
Working for a leader in power electronics, this is a great opportunity to join a growing team as a UVM verification engineer.
Job Duties:
Developing test plans, tests, and verification infrastructure using SV/UVM methodology
Building reusable bus functional models, monitors, checkers, and scoreboards
Performing coverage-driven
Working for a US based, fabless semiconductor design company, focusing on low-power, high-definition and Ultra HD video compression, image processing, and computer vision processors for AI applications.
You will be working in a growing team of multi-skilled engineers - across technical disciplines such as digital / analog / mixed-signal in design,
Working for a US based, fabless semiconductor design company, focusing on low-power, high-definition and Ultra HD video compression, image processing, and computer vision processors for AI applications. You will be working in a growing team of multi-skilled engineers - across technical disciplines such as digital / analog / mixed-signal in design,
An excellent opportunity has become available for a IC Test Development Engineer to join a worldwide electronics company that focuses on the development of innovative technology in the field of power electronics. As an IC Test Development Engineer you will have a number of core responsibilities that include:Maintaining production test software and
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Our client is a leading innovator in the field of autonomous vehicle technology, dedicated to shaping the future of transportation. To strengthen their Functional Safety Team, they are currently seeking a System & Safety Engineer to join their team in Parma. This role offers a salary of up to 55,000 as well as the ability to work a hybrid model (3
Stiamo cercando un* Digital Advertising Specialist per la nostra sede di Reggio Emilia.
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Fonte del Lavoro: Webranking srl
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Working for a leader in power in power electronics, this is a great opportunity to join a growing team, as UVM verification engineer.Job duties:Developing test plans, tests and verification infrastructure using SV/UVM methodologyBuilding reusable bus functional models, monitors, checkers and scoreboardsPerforming coverage driven verification closurePerforming block level, multi-block level and system-level verificationPerforming Gate level simulationsPerforming Mixed Signal simulationsImplementing Regression testsPerforming Formal VerificationWorking closely with IC designers and post-silicon engineersQualifications and BackgroundRequirements:Knowledge/experience with HDL (SystemVerilog / Verilog / VHDL), particularly for testbenches creationKnowledge/experience in scripting languages, such as Tcl and PythonSome knowledge of ASIC design flow and related verification stepNice to have:Some experience in digital RTL designKnowledge of UVM environments and classesSome experience with main EDA vendors simulators such as Questasim and XceliumKnowledge of DFT structures and test pattern generationSome experience in silicon validation/characterisationExperience working on Git.For more information, please contact Rob Hudson.Parma, Emilia RomagnaPermanent30-65k depending on experienceV-189753+44 (0)118 988 [email protected]